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Auteur Sujet :

[Topic Unique] Processeurs Intel Sandy Bridge 32nm / Ivy Bridge 22nm

n°7182031
kangoorico
Posté le 27-10-2009 à 16:13:55  profilanswer
 

Reprise du message précédent :
Vu le taux d'adoptiondu 64bit au niveau logiciel, on est pas pret de voir le 128bit débarquer ...
 
Surtout quand j'entend dans les magasins d'informatique : "prennez du 32bit, il y a moins de bug qu'en 64" (véridique !!!)

mood
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Posté le 27-10-2009 à 16:13:55  profilanswer
 

n°7182047
Innolis_je​vede
Fdp surcompensé.
Posté le 27-10-2009 à 16:25:06  profilanswer
 

Je trouvais ça bizarre aussi :D alors que les 1er cpu 128bits ne sont même pas évoqués dans la presse...


Message édité par Innolis_jevede le 27-10-2009 à 17:02:52

---------------
So all my bitches and my niggas and my niggas and my bitches Wave your motherfuckin hands in the air And if you don't give a shit like we don't give a shit Wave your motherfuckin fingers in the air
n°7182089
Ovan
O_O
Posté le 27-10-2009 à 16:51:11  profilanswer
 

Je vais tourner le problème dans l'autre sens.
On sait que les mobo X58 actuelles ne seront pas compatibles, mais est-ce aussi le cas pour les bloomfield?
 
C'est peut être complètement bête comme question mais bon je demande quand même.

n°7182097
sapphire a​depte xd
Online : bisondacier
Posté le 27-10-2009 à 16:55:41  profilanswer
 

on va surtout dire que l'intérêt n'est pas le même. Pas grand monde ne revendiquera cette évolution ( changer de mobale pour le même proc => sur le x58 aucun intérêt), tandis que changer de mobale pour pouvoir changer de procal, c'est moins bien déjà :/

n°7182104
Ovan
O_O
Posté le 27-10-2009 à 16:59:15  profilanswer
 

Bah si ça permet de changer en plusieurs phases.
bloomfield+X58(v2009)->bloomfield+X58(vSandyBridge)->cpu SB + X58 SB.
 
Moi j'y vois un intérêt.

n°7182670
Zack38
Posté le 27-10-2009 à 22:48:23  profilanswer
 

Ovan a écrit :

Bah si ça permet de changer en plusieurs phases.
bloomfield+X58(v2009)->bloomfield+X58(vSandyBridge)->cpu SB + X58 SB.
 
Moi j'y vois un intérêt.


 
Il s'agira d'une nouvelle architecture, donc le moindre changement d'alimentation et paf les Bloomfield passent à la trappe ...
 
Après, c'est une possibilité, mais la probabilité qu'elle soit réelle est quasi-nulle ... [:cerveau skyzor]  
 
Et puis, quel serait l'intérêt pour Intel ? Vider les stocks de Bloomfield/Gulftown plus rapidement ?  [:bakk14]

Message cité 1 fois
Message édité par Zack38 le 27-10-2009 à 23:53:16
n°7182743
Ovan
O_O
Posté le 27-10-2009 à 23:35:29  profilanswer
 

Faudrait apprendre à lire zack, regardes mon premier post. J'en sais rien si les bloomfiled seront compatible, je demande justement.

n°7182749
Zack38
Posté le 27-10-2009 à 23:39:51  profilanswer
 

Je sais parfaitement lire, merci . :sarcastic:  
Bon, eh bien, je te laisse deviner la réponse ... :kaola:

n°7182760
Ovan
O_O
Posté le 27-10-2009 à 23:48:59  profilanswer
 

Zack38 a écrit :

Je sais parfaitement lire, merci . :sarcastic:  


 
Non non tu sais pas lire, surtout quand je vois ça :

Zack38 a écrit :


 
Et où est-ce que t'as vu que les Bloomfield pourront fonctionner sur le chipset de Sandy Bridge ? [:jean-guitou]  


 
Alors que juste au dessus j'ai mis :  
 

Ovan a écrit :


On sait que les mobo X58 actuelles ne seront pas compatibles, mais est-ce aussi le cas pour les bloomfield?


 
bref  :o

n°7182764
Zack38
Posté le 27-10-2009 à 23:51:17  profilanswer
 

Toi, t'as pas dû apprendre l'indulgence à l'école ... :sarcastic:  
J'ai zappé ton post, tout simplement . Désolé . :sweat:

mood
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Posté le 27-10-2009 à 23:51:17  profilanswer
 

n°7182829
marllt2
Posté le 28-10-2009 à 01:46:09  profilanswer
 


Des liens ?


Message édité par marllt2 le 28-10-2009 à 01:46:47
n°7182831
Profil sup​primé
Posté le 28-10-2009 à 01:50:44  answer
 

dailytech je crois, mais j'arrive plus à mettre la mains dessus.

n°7182841
couillesho​t
Les bouboules et la boubouche
Posté le 28-10-2009 à 02:20:34  profilanswer
 

Ovan a écrit :

Bah si ça permet de changer en plusieurs phases.
bloomfield+X58(v2009)->bloomfield+X58(vSandyBridge)->cpu SB + X58 SB.
 
Moi j'y vois un intérêt.


 
ah ouais? et quel est l'intérêt de changer en plusieurs phases?  :heink:


---------------
:o :o :o
n°7182904
kangoorico
Posté le 28-10-2009 à 08:41:07  profilanswer
 

couilleshot a écrit :


 
ah ouais? et quel est l'intérêt de changer en plusieurs phases?  :heink:


le banquier par hasard ? :whistle:

n°7182950
Ovan
O_O
Posté le 28-10-2009 à 09:30:44  profilanswer
 

kangoorico a écrit :


le banquier par hasard ? :whistle:


 
 :D , ça me semble logique pourtant.

n°7182982
kangoorico
Posté le 28-10-2009 à 09:52:53  profilanswer
 

Ovan a écrit :


 
 :D , ça me semble logique pourtant.


mais pourquoi est il si méchant ?? :cry:

n°7183000
Ovan
O_O
Posté le 28-10-2009 à 10:08:40  profilanswer
 

Pourquoi? l'intérêt c'est bien ce que tu as mis  :)

n°7183014
kangoorico
Posté le 28-10-2009 à 10:18:31  profilanswer
 

je parlais du banquier qui est mechant : je dois attendre le 01Nov pour acheter mon i7 :'(

n°7183058
Ovan
O_O
Posté le 28-10-2009 à 10:39:54  profilanswer
 

Ah ok  :D

n°7183072
kangoorico
Posté le 28-10-2009 à 10:45:50  profilanswer
 

range ce grand sourire, je vais m'enerver :fou:  
 
enfin le premier c'est tout de suite dimanche. mon Athlon 3000 tiendra bien encore deux semaines (moi non mais lui oui :lol: )
 
sinon fin du HS :
il n'y a pas plus de news que ca sur Sandy KiloBridge ?

n°7183182
couillesho​t
Les bouboules et la boubouche
Posté le 28-10-2009 à 11:38:23  profilanswer
 

ben désolé moi je vois pas l'intérêt d'acheter une nouvelle mobo si on peut pas y mettre les nouveaux cpu qui vont avec  :o et se retrouver avec les mêmes perfs qu'avant

Message cité 1 fois
Message édité par couilleshot le 28-10-2009 à 11:39:16

---------------
:o :o :o
n°7184129
Ovan
O_O
Posté le 28-10-2009 à 19:50:09  profilanswer
 

couilleshot a écrit :

ben désolé moi je vois pas l'intérêt d'acheter une nouvelle mobo si on peut pas y mettre les nouveaux cpu qui vont avec  :o et se retrouver avec les mêmes perfs qu'avant


 :heink:  :heink:

 

Mais bien sur qu'on peut mettre un cpu SB sur une mobo X58 SB, je dis juste que si tu n'as pas le budget pour passer complètement sur SB et que tu possèdes en ce moment un bloomfield, si Intel pouvait faire en sorte que nos i7 9xx soient compatibles mobo X58 SB , ça serait vachement bien.


Message édité par Ovan le 28-10-2009 à 19:51:19
n°7184347
couillesho​t
Les bouboules et la boubouche
Posté le 28-10-2009 à 21:47:52  profilanswer
 

:heink:   :heink:  
 
bah suffit d'attendre d'avoir le budget  :o
c'est une fausse bonne idée ton concept


Message édité par couilleshot le 28-10-2009 à 21:50:36

---------------
:o :o :o
n°7186331
marllt2
Posté le 30-10-2009 à 09:37:32  profilanswer
 

Il semble que les versions grand public du SNB n'utiliseront pas le socket LGA 1156, mais le socket H2.  
 
Oui un nouveau socket (et VRM). :whistle: Surtout pour empêcher de mettre un CPU 1156 sur une mobo SNB, ou un SNB sur une mobo 1156.
 
source: la doc Intel test tool.


Message édité par marllt2 le 30-10-2009 à 09:44:19
n°7186379
mdc888
01010100 01101111 01110101 011
Posté le 30-10-2009 à 10:14:11  profilanswer
 

:fou:  
En même temps on s'en doutait un peu...
Intel et les changement de socket, une longue, très longue histoire   :lol:

n°7186478
BIERMAN
§¤§ 19 years of HFR sanity §¤§
Posté le 30-10-2009 à 11:32:21  profilanswer
 

& sockets + chipsets => histoire sans fin :d


Message édité par BIERMAN le 30-10-2009 à 11:32:31

---------------
▬© Base CBR15 ▬© CABASSE ▬© CM AM3+ 100% &- ▬© o/c C2D&Q i7 matuer†
n°7197387
Zack38
Posté le 07-11-2009 à 18:46:35  profilanswer
 

super_newbie_pro a écrit :

Le Sandy Bridge en quelques mots
 
Spécifications du Sandy Bridge d'après une présentation faite par Intel en Décembre 2006 : Ces spécifications ont des similitudes avec le CPU intel i9 :
 
    * Successeur de l'architecture Nehalem, sera doté des nouvelles techniques de gravure en 32nm et premier CPU à utiliser les dernières technologies de réduction de fuites de courant que nous avions eu vent en 2005 et 2006 (cf : Topic news relatives aux Technologies, procédés et découvertes)
    * 4 GHz vitesse d'horloge (et oui...  :pt1cable:  :love: )
    * 4 à 8 cores
    * Nouveau jeu d'instructions AVX (Advanced Vector Extension), sera en réalité le remplaçant de SSE qui travaillera sur 256 bits, et non plus 128, et devrait voir son efficacité grandement accrue et pourra travailler sur trois opérandes. Ca va fouetter !
    * Sans SSE: 8 DP GFLOPS / (Core 2 DP FP / horloge), 32-64 DP Gflops / processeur.
    * Avec SSE: 32 DP Gflops / (core 8 DP FP / horloge), 128-256 DP Gflops / processeur.
    * 80 Ko de cache L1 / core (32 Ko L1 instruction, 32 Ko de cache L1 de données et 16 Ko par un décodeur de base), (3 horloges).
    * "trace cache" fera son retour dans cette version ( http://en.wikipedia.org/wiki/Trace_cache )
    * 512 Ko de cache L2 / core, (9 horloges).
    * 2-3 Mo de mémoire cache L3 / core (8-24 Mo au total) (33 horloges), très probablement mis en commun et la répartition dynamique entre les coeurs.
    * 64 bytes ligne de cache largeur.
    * 256 octets / cycle Ring bande passante du bus. Le bus relie les cores.
    * 0-512 MB GDDR / DRAM rapide.
    * 64 Go/s GDDR / bande passante mémoire DRAM.
    * 17 Go/s de bande passante mémoire par un lien QuickPath avec une latence de seulement 50 nanosecondes !  
 


 
C'est quoi les "X horloges" un peu partout ?

n°7197895
marllt2
Posté le 08-11-2009 à 04:21:08  profilanswer
 

Des cycles, pas des horloges.
 
Sinon, c'est quoi la source de ça ?

Citation :

Successeur de l'architecture Nehalem, sera doté des nouvelles techniques de gravure en 32nm et premier CPU à utiliser les dernières technologies de réduction de fuites de courant que nous avions eu vent en 2005 et 2006 (cf : Topic news relatives aux Technologies, procédés et découvertes)


Il s'agit du tri-gate ? http://www.intel.com/technology/si [...] d_cmos.htm
 
Parce qu'en fait cette affirmation est issue du wikipedia italien, et ne repose sur aucune source. C'est d'ailleurs pas une affirmation, mais une question.
 
http://it.wikipedia.org/wiki/Sandy_Bridge


Message édité par marllt2 le 08-11-2009 à 04:30:47
n°7197949
Zack38
Posté le 08-11-2009 à 10:12:47  profilanswer
 

Et qu'est-ce que c'est, des cycles ? :whistle:  
 
Ouais, possible que le tri-gate soit utilisé ... je crois qu'Intel avait dit qu'il l'utiliserait pour ses CPU en 32nm . [:million dollar baby]  
 
Après, Intel en a bien d'autres en réserve comme ça, cf sa fameuse technologie qui réduit la consommation de 90% . :sol:  Mais celle-là n'arrivera certainement pas de si tôt .

n°7197991
marllt2
Posté le 08-11-2009 à 10:51:15  profilanswer
 

Le trigate c'est surtout une annonce de 2005 ou 2006, dont Intel n'a plus reparlé.
 
Et que wikipedia a ressorti en supposant que ça s'appliquerait au SNB.

Message cité 1 fois
Message édité par marllt2 le 08-11-2009 à 10:51:27
n°7198083
Zack38
Posté le 08-11-2009 à 12:19:50  profilanswer
 

marllt2 a écrit :

Le trigate c'est surtout une annonce de 2005 ou 2006, dont Intel n'a plus reparlé.
 
Et que wikipedia a ressorti en supposant que ça s'appliquerait au SNB.


 
Sauf qu'Intel investit rarement plusieurs millions de dollars en R&D pour annoncer une techno inutilisée ... ce serait con, quand même ! :lol:

n°7198973
marllt2
Posté le 09-11-2009 à 02:41:12  profilanswer
 

C'est juste, mais pas de trigate avant au moins le Ivy Bridge.

Message cité 1 fois
Message édité par marllt2 le 11-11-2009 à 04:29:08
n°7199129
Zack38
Posté le 09-11-2009 à 11:07:16  profilanswer
 

marllt2 a écrit :

C'est juste, mais perso je mise sur le trigate pour le Ivy Bridge.


 
Pourquoi attendre le 22nm pour passer à l'action ? :??:  
 
Pour le moment, on a aucun chiffre concernant la consommation des SNB, on peut donc toujours espérer . :sol:  
Sans tri-gate, je vois difficilement comment Intel pourrait se permettre de sortir des CPU à 4GHz . :whistle:

n°7200226
marllt2
Posté le 10-11-2009 à 03:58:31  profilanswer
 

Parce que le trigate est une modif de process, et que les modifs de process se font lors d'un tick.
 
Pour les 4 GHz, c'est du flan. :o  Encore qu'un i7 975 (déjà à 3.33 GHz) passé au 32nm soit pas loin de ces 4 GHz.


Message édité par marllt2 le 10-11-2009 à 04:02:35
n°7200850
Zack38
Posté le 10-11-2009 à 17:04:52  profilanswer
 

Peut-être que le Gulftown en bénéficiera ? Peu probable, m'enfin sait-on jamais ... :)  
 
Ouais, sinon, toutes les infos qu'on a sur SNB sont périmées vue leur ancienneté . :o  
 
Au fait, squoi la mémoire de trace ? ... :sweat:

n°7201437
marllt2
Posté le 11-11-2009 à 04:25:44  profilanswer
 

S'il n'est pas sur le SNB, il n'est pas non plus sur un CPU lancé 1 an avant. :whistle: Toute la doc sur le 32nm est dispo sur le site d'Intel.  
 
Peut-être gardent-ils cette techno au chaud pour quand ils commenceront à avoir des soucis de réduction de gravure.
 
Là avec les 45, 32, 22nm, ils semblent vouloir aller vite.
 

Zack38 a écrit :

Au fait, squoi la mémoire de trace ?


Je ne sais pas. Cette citation est extraite de quoi ?

Message cité 2 fois
Message édité par marllt2 le 11-11-2009 à 04:28:11
n°7201571
Zack38
Posté le 11-11-2009 à 10:40:29  profilanswer
 

super_newbie_pro a écrit :


    * Successeur de l'architecture Nehalem, sera doté des nouvelles techniques de gravure en 32nm et premier CPU à utiliser les dernières technologies de réduction de fuites de courant que nous avions eu vent en 2005 et 2006 (cf : Topic news relatives aux Technologies, procédés et découvertes)
    * 4 GHz vitesse d'horloge (et oui...  :pt1cable:  :love: )
    * 4 à 8 cores
    * Nouveau jeu d'instructions AVX (Advanced Vector Extension), sera en réalité le remplaçant de SSE qui travaillera sur 256 bits, et non plus 128, et devrait voir son efficacité grandement accrue et pourra travailler sur trois opérandes. Ca va fouetter !
    * Sans SSE: 8 DP GFLOPS / (Core 2 DP FP / horloge), 32-64 DP Gflops / processeur.
    * Avec SSE: 32 DP Gflops / (core 8 DP FP / horloge), 128-256 DP Gflops / processeur.
    * 80 Ko de cache L1 / core (32 Ko L1 instruction, 32 Ko de cache L1 de données et 16 Ko par un décodeur de base), (3 horloges).
    * "trace cache" fera son retour dans cette version ( http://en.wikipedia.org/wiki/Trace_cache )
    * 512 Ko de cache L2 / core, (9 horloges).
    * 2-3 Mo de mémoire cache L3 / core (8-24 Mo au total) (33 horloges), très probablement mis en commun et la répartition dynamique entre les coeurs.


 

marllt2 a écrit :

S'il n'est pas sur le SNB, il n'est pas non plus sur un CPU lancé 1 an avant. :whistle: Toute la doc sur le 32nm est dispo sur le site d'Intel.  
 
Peut-être gardent-ils cette techno au chaud pour quand ils commenceront à avoir des soucis de réduction de gravure.
 
Là avec les 45, 32, 22nm, ils semblent vouloir aller vite.
 
 
Je ne sais pas. Cette citation est extraite de quoi ?


 
Intel n'ira pas plus vite que son tick-tock le permet .
Et, je le redemande, qu'est-ce que c'est que les "cycles" ? Les Hz par Hz ? Et c'est quoi le décodeur de base dont il est fait mention dans le wiki anglais ?

n°7202624
mrbebert
Posté le 11-11-2009 à 21:25:56  profilanswer
 

Un cycle, c'est un "coup" d'horloge. Quand un proc fonctionne à 1 Ghz, il traite 1 milliard de "cycles" à chaque seconde.
On va se baser la dessus pour déterminer le rendement d'un processeur, c'est à dire la quantité de travail effectué pour un nombre de cycles donnés. Ce rendement, n'est pas le même entre différents processeur, et donc un processeur peut être plus performant tout en étant moins rapide (en fréquence).

Zack38 a écrit :

Peut-être que le Gulftown en bénéficiera ? Peu probable, m'enfin sait-on jamais ... :)  
 
Ouais, sinon, toutes les infos qu'on a sur SNB sont périmées vue leur ancienneté . :o  
 
Au fait, squoi la mémoire de trace ? ... :sweat:

Traduction (pas géniale) de "trace cache", j'imagine ?
Un processeur x86 n'exécute pas directement les instructions x86. Il les décode (convertit) en micro-instructions qui seront, elles, traitées par les différentes unités (dan un ordre pouvant être différent de leur ordre d'entrée).
Le trace cache est un cache sur cette opération de décodage :)  

n°7202652
Zack38
Posté le 11-11-2009 à 21:49:12  profilanswer
 

mrbebert a écrit :

Un cycle, c'est un "coup" d'horloge. Quand un proc fonctionne à 1 Ghz, il traite 1 milliard de "cycles" à chaque seconde.
On va se baser la dessus pour déterminer le rendement d'un processeur, c'est à dire la quantité de travail effectué pour un nombre de cycles donnés. Ce rendement, n'est pas le même entre différents processeur, et donc un processeur peut être plus performant tout en étant moins rapide (en fréquence).
Traduction (pas géniale) de "trace cache", j'imagine ?
Un processeur x86 n'exécute pas directement les instructions x86. Il les décode (convertit) en micro-instructions qui seront, elles, traitées par les différentes unités (dan un ordre pouvant être différent de leur ordre d'entrée).
Le trace cache est un cache sur cette opération de décodage :)  


 
Ok, pour les cycles, c'est bien ce que je me disais, mais alors pourquoi il y a des chiffres à côté ? Ils vont exécuter un nombre de cycles différent de celui du CPU ? :heink:  
Et aussi merci pour l'explication de la mémoire cache de "décodage" . :jap:  C'est un peu plus clair, maintenant . Donc, en fait :
 

Citation :

...et 16 Ko par un décodeur de base), (3 horloges).  
    * "trace cache" fera son retour dans cette version ( http://en.wikipedia.org/wiki/Trace_cache )


 
... ça veut dire la même chose .
Mais pourquoi elle fera son retour dans SNB ? Avant, les CPU ne décodaient pas le x86 ? C'est louche, cette histoire :sweat:

n°7202736
mrbebert
Posté le 11-11-2009 à 22:55:27  profilanswer
 

Zack38 a écrit :


 
Ok, pour les cycles, c'est bien ce que je me disais, mais alors pourquoi il y a des chiffres à côté ? Ils vont exécuter un nombre de cycles différent de celui du CPU ? :heink:


Parce qu'un processeur peut faire plusieurs choses à chaque "tic" d'horloge (chaque cycle). Il y a plusieurs unités, qui travaillent en parallèle. J'imagine que ces chiffres indiquent le nombre d'instructions que peut traiter (dans un cas idéal) le processeur à chaque cycle. Ou le nombre de données ? (c'est différent avec les instructions vectorielles où une instruction s'applique à plusieurs données d'un coup)
En fait, je comprends pas ce que ca signifie. Faudrait avoir l'original en anglais, la traduction est ... peu claire :ange:  
 

Zack38 a écrit :

Et aussi merci pour l'explication de la mémoire cache de "décodage" . :jap:  C'est un peu plus clair, maintenant . Donc, en fait :
 

Citation :

...et 16 Ko par un décodeur de base), (3 horloges).  
    * "trace cache" fera son retour dans cette version ( http://en.wikipedia.org/wiki/Trace_cache )


 
... ça veut dire la même chose .
Mais pourquoi elle fera son retour dans SNB ? Avant, les CPU ne décodaient pas le x86 ? C'est louche, cette histoire :sweat:

Que les processeurs décodent, ca reste vrai. La différence, c'est qu'ici, il décode et met en cache les instructions décodées. S'il revient dessus, il n'aura plus à les décoder :)
Du moins, c'est ce qu'on avait sur les P4, il y aura peut être des nuances sur ce processeur :)

Message cité 1 fois
Message édité par mrbebert le 11-11-2009 à 23:03:28
n°7202909
marllt2
Posté le 12-11-2009 à 05:22:45  profilanswer
 

marllt2 a écrit :

Là avec les 45, 32, 22nm, ils semblent vouloir aller vite.


Zack38 a écrit :

Intel n'ira pas plus vite que son tick-tock le permet .


 :??:  Tu prends le problème à l'envers.  
 
C'est parce qu'ils vont vite qu'ils ont mis en place le tick tock. Enfin, pas le tick tock lui même, mais le rythme.
 
Et d'ailleurs ce rythme se ralentit déjà. Donc raison de plus pour Intel d'utiliser les trucs comme le trigate quand ils en auront vraiment besoin.
 
Et avec les yields et l'efficacité des 45nm et 32nm, c'est facile à comprendre que pour l'instant le Trigate et co ils s'en fichent un peu.
 
Il laissent ça en R&D, ce qui permet de l'améliorer encore, et l'utiliseront quand ils en auront besoin.
 

mood
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