[Topic Unique] Processeurs Intel Sandy Bridge 32nm / Ivy Bridge 22nm

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Auteur	Sujet : [Topic Unique] Processeurs Intel Sandy Bridge 32nm / Ivy Bridge 22nm

marllt2

REX, what else ?

Reprise du message précédent :

marllt2 a écrit :

Là avec les 45, 32, 22nm, ils semblent vouloir aller vite.

Zack38 a écrit :

Intel n'ira pas plus vite que son tick-tock le permet .

:??: Tu prends le problème à l'envers.

C'est parce qu'ils vont vite qu'ils ont mis en place le tick tock. Enfin, pas le tick tock lui même, mais le rythme.

Et d'ailleurs ce rythme se ralentit déjà. Donc raison de plus pour Intel d'utiliser les trucs comme le trigate quand ils en auront vraiment besoin.

Et avec les yields et l'efficacité des 45nm et 32nm, c'est facile à comprendre que pour l'instant le Trigate et co ils s'en fichent un peu.

Il laissent ça en R&D, ce qui permet de l'améliorer encore, et l'utiliseront quand ils en auront besoin.

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Zack38

Quanta ?

mrbebert a écrit :

Parce qu'un processeur peut faire plusieurs choses à chaque "tic" d'horloge (chaque cycle). Il y a plusieurs unités, qui travaillent en parallèle. J'imagine que ces chiffres indiquent le nombre d'instructions que peut traiter (dans un cas idéal) le processeur à chaque cycle. Ou le nombre de données ? (c'est différent avec les instructions vectorielles où une instruction s'applique à plusieurs données d'un coup)
En fait, je comprends pas ce que ca signifie. Faudrait avoir l'original en anglais, la traduction est ... peu claire :ange:

Que les processeurs décodent, ca reste vrai. La différence, c'est qu'ici, il décode et met en cache les instructions décodées. S'il revient dessus, il n'aura plus à les décoder
Du moins, c'est ce qu'on avait sur les P4, il y aura peut être des nuances sur ce processeur

En même temps, Sandy Bridge inaugure l'arrivée de l'AVX, successeur du SSE . Normal qu'il y ait quelques changements architecturaux qui induisent l'incompréhension momentanée . On aura probablement plus d'informations en 2010 ...

marllt2 a écrit :

Pourquoi tu dis que le rythme ralentit ? :??:

Intel a sorti ses Bloomfield quelques mois à l'avance . J'appelle pas ça un ralentissement mais une accélération du tick-tock . :pt1cable:

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Golden Diva

Je ne pense pas que Bloomfield ait été en avance sur le planning d'Intel.

Normalement, le tick-tock, c'est une évolution chaque année : soit un die shrink, soit un changement d'architecture.

Et il prévoyait

- Penryn fin 2007 (tenu)
- Nehalem fin 2008 (tenu) (pas spécialement en avance :??: )
- Westmere fin 2009 (RATE !)
- Sandy Bridge fin 2010 (raté ?)
- Ivy Bridge fin 2011 (on n'en sait encore rien )

Message cité 2 fois

Zack38

Quanta ?

Golden Diva a écrit :

J'ai pas compris ça comme ça, moi ... :heink:
2008 = Penryn (45nm)
2009 = Nehalem
2010 = Westmere (32nm)
2011 = Sandy Bridge
2012 = Ivy Bridge (22nm)
2013 = Haswell
2014 = ??? (16nm ou abandon du CMOS pour la nanoélectronique)

Message cité 1 fois

marllt2

REX, what else ?

Zack38 a écrit :

Pourquoi tu dis que le rythme ralentit ?

Intel a sorti ses Bloomfield quelques mois à l'avance . J'appelle pas ça un ralentissement mais une accélération du tick-tock . :pt1cable:

Juillet 2006: tock C2D
Octobre 2007: tick Penryn
Novembre 2008: tock Nehalem (et que pour le HDG)
Janvier 2010: tick Westmere
J'appelle pas ça une accélération. [:cosmoschtroumpf]

Golden Diva a écrit :

Normalement, le tick-tock, c'est une évolution chaque année : soit un die shrink, soit un changement d'architecture.

La nuance porte sur l'année calendaire vs "tous les 12 mois".

Et là en moyenne, Intel semble plus sur un rythme de 14 mois que de 12 mois.

Donc là le Westmere qui est lancé en 2010, au lieu de 2009, fait penser à un retard ponctuel, alors que ce n'est pas le cas.

Zack38 a écrit :

J'ai pas compris ça comme ça, moi ...

2008 = Penryn (45nm)
2009 = Nehalem
2010 = Westmere (32nm)
2011 = Sandy Bridge
2012 = Ivy Bridge (22nm)
2013 = Haswell
2014 = ??? (16nm ou abandon du CMOS pour la nanoélectronique)

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Message édité par marllt2 le 13-11-2009 à 05:24:01

0b1

Misc @ SWToR

[:lardoncru]

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* Feedback * Membre du PiseptO (Paidai i7 Owner)

Profil supprimé

marllt2 a écrit :

Juillet 2006: tock C2D
Octobre 2007: tick Penryn
Novembre 2008: tock Nehalem (et que pour le HDG)
Janvier 2010: tick Westmere
J'appelle pas ça une accélération. [:cosmoschtroumpf]

Ni un ralentissement non plus [:childerik]

Zack38

Quanta ?

Ah, si, là, c'est un ralentissement . Progressif, donc le ralentissement est plus difficilement perceptible .

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Profil supprimé

Zack38 a écrit :

Ah, si, là, c'est un ralentissement . Progressif, donc le ralentissement est plus difficilement perceptible .

:??:

Juillet 2006 - Octobre 2007 : 15 mois
Octobre 2007 - Novembre 2008 : 13 mois
Novembre 2008 - Janvier 2010 : 14 mois

Ni ralentissement, ni accélération. Vous chipotez pour un mois, si ?

BIERMAN

Around 10 HFR years w/o sequel

Je vais trancher
INTEL prend un retard continu, des 2 ans annoncés pour chaque cycle complet (tick/tock), il reste plus grand chose
Il ~~nous~~ doit même nous rendre des comptes à ce rythme !

Message édité par BIERMAN le 15-11-2009 à 11:29:27

---------------
╘■ Cartes AM3+ compatibles 100% &- ╘■ AMD HD 68x0 ╘■ XFX HD 587X ╘■ o/c des INTEL C2D&C2Q† ╘■ F3€D

hawak's

humble & savoir vivre ensemble

La firme de Santa Clara peut se permettre de prendre du retard...Pourquoi doivent-ils se gêner ? :sol:
La performance pure est de leur côté...
A moins que la tortue AMD décide enfin et réellement casser cette paisible tranquillité qui règne chez intel en sortant des CPU de très haut niveau dans le domaine de la performance...là Oui ils auront constamment le feu au c....

En tout cas je suis impatient de voir ce que va réellement donner l'un des espoirs d'AMD: le Bulldozer…

Message cité 2 fois
Message édité par hawak's le 15-11-2009 à 13:17:18

---------------
ASrock ♥⇔ X79 EXTREME ⇔♥ The New King of OC ?

Gein

[:drap]

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Ma p'tite galerie ☺

Profil supprimé

hawak's a écrit :

La firme de Santa Clara peut se permettre de prendre du retard...Pourquoi doivent-ils se gêner ? :sol:
La performance pure est de leur côté...
A moins que la tortue AMD décide enfin et réellement caser cette paisible tranquillité qui règne chez intel en sortant des CPU de très haut niveau dans le domaine de la performance...là Oui ils auront constamment le feu au c....

En tout cas je suis impatient de voir ce que va réellement donner l'un des espoirs d'AMD: le Bulldozer…

C'est un topic sandy bridge ou le fan club d'AMD ici ?

Merci de recentrer le débat.

Message cité 1 fois
Message édité par Profil supprimé le 15-11-2009 à 11:49:30

Ramichou

hawak's a écrit :

En tout cas je suis impatient de voir ce que va réellement donner l'un des espoirs d'AMD: le Bulldozer…

Le seul espoir d'AMD plutôt !

hawak's

humble & savoir vivre ensemble

calmossss...... Pas la peine d'être inquiet concernant mes intentions, je sais où je me trouve...

Néanmoins, on peut parfaitement rester dans le débat comme je le fais, tout en faisant allusion s'il le faut aux efforts du conçurent dans la construction du message qu'on veut passer..

Un peu de liberté d'expression, ça n'a jamais fait de mal, au contraire...

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ASrock ♥⇔ X79 EXTREME ⇔♥ The New King of OC ?

super_newbie_pro

A ta dispoition frère geek :P

En 2010, l'architecture Sandy Bridge, anciennement appelée Gesher, succédera à Nehalem. Celui-ci devrait être doté de 8 cœurs sur le même die (mais aussi 4 source : http://news.softpedia.com/news/Int [...] 5948.shtml ), d’un cache L2 de 512 Ko par cœur et d’un cache L3 de 16 Mo. L’une des caractéristiques principale de Sandy Bridge sera l’ajout du jeu d’instruction AVX (Advanced Vectors Extensions), autrefois connu sous le nom VSSE ( source :

L'arrivée de l'AVX sera probablement aussi marquante que lorsque le SSE est apparu sur les Pentium III en 1999. Les trois points principaux sont :

* L’extension des registres SSE actuels de 128 à 256 bits, tout en restant compatibles avec les instructions SSE 128 bits.
* Le réarrangement avancé de données : une seule opération pourra traiter simultanément 8 données de 32 bits
* La possibilité d’utiliser trois ou quatre opérandes

Intel annonce d’ores et déjà que l’utilisation de l’AVX en lieu et place du SSE accélérera le traitement de certaines opérations comme la multiplication de matrices d’environ 90%.

Prévu pour 2012 au plus tôt, la famille de CPU Haswell succédera à l'architecture Sandy Bridge. Gravés en 22 nm, ils devraient inclure 8 cœurs par défaut, une toute nouvelle architecture de caches, des mécanismes "révolutionnaires" d'économie d'énergie ainsi que la possibilité d'embarquer des coprocesseurs de traitement vectoriels dans un package unique. Côté jeu d’instructions, le serpent de mer FMA (Fused Multiply-Add), qui permet d’effectuer simultanément une opération de multiplication et une addition via la même instruction, devrait être implémenté.

Aucune autre information n'a filtré sur Haswell, mais vu que nous parlons d'un CPU qui sortira dans 3 générations, ce n'est pas étonnant. Le design du processeur n'en est encore qu'aux premiers balbutiements.

**********

Autres infos :

Citation :

A series of details on Intel's upcoming 32nm Sandy Bridge architecture emerged into the wild today, showing that the A0 stepping reached the final stage of its design cycle in the 23rd week of the ongoing year. According to the news, the fresh CPU should become available on the market sometime in 2011, probably in the first quarter of the year, while sporting a quad-core design.

The quad-core Sandy Bridge chip is expected to come as a mainstream silicon, while also sporting 256KB L2 cache. The core clock of the processor is estimated to have been set at a frequency placed in the 2.8GHz to 3.4GHz range, though the Turbo mode will probably bring one of the cores up to values in the 3.8GHz to 4GHz range.

One more important detail about Intel's Sandy Bridge is that the CPU should come to the market packing a 32nm integrated graphics core running at 1.0GHz to 1.4GHz, which should be connected to the chip's L3 cache. Moreover, the silicon also sports integrated dual-channel DDR3-1600 memory controller, as well as the Sandy Bridge System Agent (Northbridge) that provides PCIe 2.0, DMI and PCU.

Other features of the quad-core Sandy Bridge chip include HyperTreading, AVX Ext instruction set, 256-bit vectors, 4 operands, AEX instructions, unrestricted VMX, and 8MB of shared L3 cache, not to mention the fact that its integrated graphics chip is reported to be able to rival low-end graphics cards from ATI or NVIDIA, though these might be only rumors in the end.

Intel's Sandy Bridge is reported to come with a TDP of 85W, while measuring 225mm², each core measuring around 20mm². Although no details are available at the moment, Guru3d also points towards upcoming dual-core and eight-core Sandy Bridge chips. At the same time, the news point towards the presence of the Socket 1156 of Clarkdale (Westmere generation), and shows that the IGP is based on GMA and not Larabee.

source : http://news.softpedia.com/news/Int [...] 5948.shtml

Message édité par super_newbie_pro le 17-11-2009 à 16:17:21

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Zack38

Quanta ?

Ahhhh ... [:bakk43]

En fait, 4GHz ne pourra être atteint que par une poignée de processeurs, et seulement en cas de Turbo sur un core . [:bakk37]

Les SNB seront également équipés d'un ... contrôleur bicanal à 1600MHz ? Qu'est-ce que c'est que ce délire ? [:bakk64]

Les dernières news indiquent que le Bulldozer pourra gérer le bicanal à 1866MHz ... Hum, non, cette news doit être erronée .

Intel rétrograderait en ne proposant que du bicanal alors qu'aujourd'hui c'est du tricanal . [:bakk4]

Citation :

Other features of the quad-core Sandy Bridge chip include HyperTreading, AVX Ext instruction set, 256-bit vectors, 4 operands, AEX instructions, unrestricted VMX[...]

Quelle est la différence entre l'AVX et les vecteurs à 256bit ? Le premier n'introduit pas l'autre ? [:bakk5]

Et, on sait si Bulldozer sera équipé de tels ... trucs ? (hormis l'Hyper-Threading, si cher à Intel)

Et, dernière question, qu'est-ce que c'est les opérandes ? Ca change quoi que le CPU puisse en gérer 4 ?

orionx31

Ca poutre des Ours !

tricanal : s1366
bicanal : s1156

---------------
***Mon Fide*** / ***Mon thopique hache'a/venteu***

Zack38

Quanta ?

Je suis parfaitement au courant .

Sauf que ça m'étonne que les news indiquent du bicanal seulement ... généralement, les specs sont exagérées, c'est pourquoi on savait que Nehalem gérait le tricanal longtemps à l'avance, par contre on a su que beaucoup plus tard que les Lynnfield seraient bicanal . Mon raisonnement est compréhensible, ou bien ... ? :na:

orionx31

Ca poutre des Ours !

ouais...mais bon bicanal annoncé ne veut pas forcément dire simple canalà la sortie

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***Mon Fide*** / ***Mon thopique hache'a/venteu***

Fly2thesky

bonjour ,

quel socket pour cette new technologie ? <_<

merci

orionx31

Ca poutre des Ours !

1156 (i3/i5/i7) et 1366 (i9)

Message édité par orionx31 le 30-11-2009 à 13:19:48

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***Mon Fide*** / ***Mon thopique hache'a/venteu***

BIERMAN

Around 10 HFR years w/o sequel

:non:
Nouveau socket obligé

Message cité 1 fois

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orionx31

Ca poutre des Ours !

excat, j'ai condonfu

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BIERMAN

Around 10 HFR years w/o sequel

P'est cas vrage [:obanon]

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Zack38

Quanta ?

BIERMAN a écrit :

:non:
Nouveau socket obligé

D'après ce que j'ai compris, ce sera les ^m sockets, par contre les chipsets ne seront évidemment pas les ^m .

BIERMAN

Around 10 HFR years w/o sequel

Hmm, alors 1166 ou 1356 [:argue]

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Fly2thesky

Omg alors c'est un nouveau socket ?
<_< pffiou alors que les prochains AMD seront sur le meme socket actuel

dommage de passer d'une config I(5/7/9) a un nouveau proco sur un nouveau socket egalement....

Message édité par Fly2thesky le 30-11-2009 à 19:06:32

Zack38

Quanta ?

BIERMAN a écrit :

Hmm, alors 1166 ou 1356 [:argue]

En lieu et place du P55 et du X58, le P65 et le X68 . Par contre, toujours du LGA1156 et du LGA1366 .

BIERMAN

Around 10 HFR years w/o sequel

Oui donc nouveau socket
Tu vas dessouder celui de ta carte mère actuelle toi :spamafote: !?
[:ddr555]

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Zack38

Quanta ?

Sauf qu'aujourd'hui c'est du LGA1366 et du LGA1156, donc les sockets seront les mêmes

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BIERMAN

Around 10 HFR years w/o sequel

Zack38 a écrit :

Sauf qu'aujourd'hui c'est du LGA1366 et du LGA1156, donc les sockets seront les mêmes

Mais pas compatible à cause du socket posé sur les CMs actuelles => changement de socket

Spoiler :

jeu l'auré un jour, je l'auré [:ruxx]

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Zack38

Quanta ?

BIERMAN a écrit :

Mais pas compatible à cause du socket posé sur les CMs actuelles => changement de socket

Spoiler :

jeu l'auré un jour, je l'auré [:ruxx]

Et pourquoi incompatible ?
C'est le chipset qui sera incompatible . Le socket, ça reste à voir . 'Toute façon, il sera impossible de faire fonctionner un Core i3/i5/i7 sur un P65 ... :kaola:

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BIERMAN

Around 10 HFR years w/o sequel

Laisse [:greysoul]

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Zack38

Quanta ?

Tu as dû te tromper de jour, BIERMAN ...
On est lundi aujourd'hui, va te falloir attendre quelques jours avant de recommencer à troller

kunta92

Zack38 a écrit :

Et pourquoi incompatible ?
C'est le chipset qui sera incompatible . Le socket, ça reste à voir . 'Toute façon, il sera impossible de faire fonctionner un Core i3/i5/i7 sur un P65 ... :kaola:

pourquoi ?

les pentium 4 fonctionnent bien avec les P45, X48 etc...

---------------
"C'est aussi étonnant de voir que pas mal de personnes n'ont aucun recul sur ce qu'ils aimeraient réellement faire dans la vie, et pensent qu'avoir une école de rang A et un job conformiste en costard cravate en fait des gens passionnants." in_your_phion

super_newbie_pro

A ta dispoition frère geek :P

Le wiki anglais présente des données dont certaines semblent nouvelles :

* A0 Stepping
* 2.8 GHz to 3.4 Ghz clock speed with TurboBoost Technology disabled.
* 3.0 Ghz to 3.8 Ghz clock speed with TurboBoost Technology enabled.
* Processing cores will feature Hyper-Threading Technology that is also present in Intel Nehalem processors, as well as Intel Pentium 4 processors.
* 4 cores by default.
* Approximate 225 mm² die size by default.
* Without SSE: 8 DP GFLOPS/core (2 DP FP/clock), 32-64 DP GFLOPS/processor.
* With SSE: 32 DP GFLOPS/core (8 DP FP/clock), 128-256 DP GFLOPS/processor.
* 128 KB L1 cache/core, (3 clocks).
* Trace cache will make its come back in this version.
* 1024 KB L2 cache/core, (9 clocks).
* 16 MB shared L3 cache/DIE (25 clocks). This L3 cache will also be shared with the integrated graphic core.
* 64 bytes cache line width.
* Integrated graphic core running at 1.0 GHz to 1.4 GHz.
* Integrated Memory Controller with maximum 25.6 GB/s bandwidth, supports DDR3-1600 dual channel RAM.
* 256 bit/cycle Ring bus bandwidth. The ring bus connects the cores.
* Maximum Thermal Design Power (TDP) of 85W by default.
* Release date is expected at Q1 2011.

Qu'en pensez-vous ?

Message cité 1 fois

---------------
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kunta92

que s'ils veulent faire des octocores, ils devront prendre deux dies et les "fusionner" comme ils font à chaque fois non ?

Message cité 1 fois
Message édité par kunta92 le 20-12-2009 à 23:22:35

Zack38

Quanta ?

super_newbie_pro a écrit :

Le wiki anglais présente des données dont certaines semblent nouvelles :

* A0 Stepping
* 2.8 GHz to 3.4 Ghz clock speed with TurboBoost Technology disabled. Jusqu'à 3.40GHz ? Pas mal ... alors les SNB auront une FdB de 200MHz ?
* 3.0 Ghz to 3.8 Ghz clock speed with TurboBoost Technology enabled. Intel atteindra 4GHz en 22nm
* Processing cores will feature Hyper-Threading Technology that is also present in Intel Nehalem processors, as well as Intel Pentium 4 processors.
* 4 cores by default. et les dualcore ??! On les oublie ??!
* Approximate 225 mm² die size by default.
* Without SSE: 8 DP GFLOPS/core (2 DP FP/clock), 32-64 DP GFLOPS/processor.
* With SSE: 32 DP GFLOPS/core (8 DP FP/clock), 128-256 DP GFLOPS/processor.
* 128 KB L1 cache/core, (3 clocks).
* Trace cache will make its come back in this version.
* 1024 KB L2 cache/core, (9 clocks).
* 16 MB shared L3 cache/DIE (25 clocks). This L3 cache will also be shared with the integrated graphic core.
* 64 bytes cache line width.
* Integrated graphic core running at 1.0 GHz to 1.4 GHz.
* Integrated Memory Controller with maximum 25.6 GB/s bandwidth, supports DDR3-1600 dual channel RAM.
* 256 bit/cycle Ring bus bandwidth. The ring bus connects the cores.
* Maximum Thermal Design Power (TDP) of 85W by default.
* Release date is expected at Q1 2011.

Qu'en pensez-vous ?

Zack38

Quanta ?

kunta92 a écrit :

que s'ils veulent faire des octocores, ils devront prendre deux dies et les "fusionner" comme ils font à chaque fois non ?

Aujourd'hui, les Xeon Beckton possèdent 8 coeurs natifs . Et la limite de l'architecture NEHALEM ne s'arrête pas là : Intel a prévu un modèle à 16 coeurs ... natifs ? Je ne sais plus .

En tout cas, les nouvelles architectures multicore semblent plus modulaires que jamais .

regis183

Rien de nouveau:

Westmere sera le remplaçant de nehalem (i7 en 45nm) sur la gamme performance.

L'entrée de gamme continuera à être occupé par les clarkdale (avec une baisse de prix), et le haut de gamme par le gulftown.

Puis avec le 22nm, Intel pourra proposer un 8 coeurs en haut de gamme, et un IGP plus puissant pour l'entrée de gamme.

En fait le cycle de vie de chaque produit doit durer 2 ans pour optimiser la rentabilité (vrai également pour les cartes mères).

Message édité par regis183 le 21-12-2009 à 07:19:55

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